文件名称:DE2_Top

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2013-08-20
  • 文件大小:
  • 18kb
  • 下载次数:
  • 1次
  • 提 供 者:
  • y***
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  • 下载说明:
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介绍说明--下载内容均来自于网络,请自行研究使用

此设计是一个裸机的设计,其中包含在DE2开发板所有的引脚分配。它还包含一个与所有的对应于每个引脚的输入/输出端口的Verilog模块。这可以被用来作为一个起点上的电路板的设计。-This design is a bare-bones design containing all the pin assignments available on the DE2 board. It also contains a Verilog module with all the input/output ports corresponding to each pin. This can be used as a starting point for designs on the board.
(系统自动生成,下载前可以参看下载内容)

下载文件列表





DE2_Top\DE2_TOP.pof

.......\DE2_TOP.qpf

.......\DE2_TOP.qsf

.......\DE2_TOP.sof

.......\DE2_TOP.v

.......\README.txt

DE2_Top

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