文件名称:ethernet__verilog

  • 所属分类:
  • 其它资源
  • 资源属性:
  • [PDF]
  • 上传时间:
  • 2008-10-13
  • 文件大小:
  • 323.51kb
  • 下载次数:
  • 0次
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fpga模拟以太网物理层的源代码,用verilog硬件描述语言开发。
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 111186775ethernet__verilog.rar 列表
ethernet__verilog\bench\CVS\Entries
ethernet__verilog\bench\CVS\Repository
ethernet__verilog\bench\CVS\Root
ethernet__verilog\bench\verilog\CVS\Entries
ethernet__verilog\bench\verilog\CVS\Repository
ethernet__verilog\bench\verilog\CVS\Root
ethernet__verilog\bench\verilog\tb_eth_top.v
ethernet__verilog\CVS\Entries
ethernet__verilog\CVS\Repository
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ethernet__verilog\rtl\verilog\eth_macstatus.v
ethernet__verilog\rtl\verilog\eth_miim.v
ethernet__verilog\rtl\verilog\eth_outputcontrol.v
ethernet__verilog\rtl\verilog\eth_random.v
ethernet__verilog\rtl\verilog\eth_receivecontrol.v
ethernet__verilog\rtl\verilog\eth_register.v
ethernet__verilog\rtl\verilog\eth_registers.v
ethernet__verilog\rtl\verilog\eth_rxcounters.v
ethernet__verilog\rtl\verilog\eth_rxethmac.v
ethernet__verilog\rtl\verilog\eth_rxstatem.v
ethernet__verilog\rtl\verilog\eth_shiftreg.v
ethernet__verilog\rtl\verilog\eth_sync_clk1_clk2.v
ethernet__verilog\rtl\verilog\eth_top.v
ethernet__verilog\rtl\verilog\eth_transmitcontrol.v
ethernet__verilog\rtl\verilog\eth_txcounters.v
ethernet__verilog\rtl\verilog\eth_txethmac.v
ethernet__verilog\rtl\verilog\eth_txstatem.v
ethernet__verilog\rtl\verilog\eth_wishbonedma.v
ethernet__verilog\rtl\verilog\timescale.v
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ethernet__verilog\doc
ethernet__verilog\rtl
ethernet__verilog\sim
ethernet__verilog

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