文件名称:clkgen
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用ＭＡＴＬＡＢ产生各种时钟信号，对于不同的模块产生适当的始终信号．
(系统自动生成,下载前可以参看下载内容)
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压缩包 : 19854791clkgen.rar 列表 clkgen\clkgen.cr.mti clkgen\clkgen.mpf clkgen\clk_div.v clkgen\clk_gen.v clkgen\test.v clkgen\top.fsdb clkgen\transcript clkgen\work\_info clkgen\work\top\verilog.asm clkgen\work\top\_primary.dat clkgen\work\top\_primary.vhd clkgen\work\top clkgen\work\clk_gen\verilog.asm clkgen\work\clk_gen\_primary.dat clkgen\work\clk_gen\_primary.vhd clkgen\work\clk_gen clkgen\work\clk_div\verilog.asm clkgen\work\clk_div\_primary.dat clkgen\work\clk_div\_primary.vhd clkgen\work\clk_div clkgen\work clkgen