文件名称:fangbo
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一个可切换分频的时钟分频器的verilog语言，可根据具体情况修改参数实现不同的分频-A switchable clock divider divider verilog language, modify the parameters according to the specific circumstances of different sub-frequency
(系统自动生成,下载前可以参看下载内容)
下载文件列表
fangbo
......\db
......\..\fangbo.asm.qmsg
......\..\fangbo.asm_labs.ddb
......\..\fangbo.cbx.xml
......\..\fangbo.cmp.bpm
......\..\fangbo.cmp.cdb
......\..\fangbo.cmp.ecobp
......\..\fangbo.cmp.hdb
......\..\fangbo.cmp.kpt
......\..\fangbo.cmp.logdb
......\..\fangbo.cmp.rdb
......\..\fangbo.cmp_merge.kpt
......\..\fangbo.cuda_io_sim_cache.45um_ff_1200mv_0c_fast.hsd
......\..\fangbo.cuda_io_sim_cache.45um_ss_1200mv_85c_slow.hsd
......\..\fangbo.db_info
......\..\fangbo.eco.cdb
......\..\fangbo.eds_overflow
......\..\fangbo.fit.qmsg
......\..\fangbo.fnsim.cdb
......\..\fangbo.fnsim.hdb
......\..\fangbo.fnsim.qmsg
......\..\fangbo.hier_info
......\..\fangbo.hif
......\..\fangbo.lpc.html
......\..\fangbo.lpc.rdb
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......\..\fangbo.map_bb.hdb
......\..\fangbo.map_bb.logdb
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......\..\fangbo.pre_map.hdb
......\..\fangbo.rtlv.hdb
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......\..\fangbo.sld_design_entry_dsc.sci
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......\..\prev_cmp_fangbo.fit.qmsg
......\..\prev_cmp_fangbo.map.qmsg
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......\..\prev_cmp_fangbo.sta.qmsg
......\..\wed.wsf
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......\..............\...................\fangbo.root_partition.cmp.atm
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