文件名称:dds1

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [C/C++] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 1.5mb
  • 下载次数:
  • 0次
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用ALTERA 公司的fpga芯片,编程语言是VerilogHDL,实现DDS数字信号发生器,可以产生正弦信号,三角信号,矩形信号。-ALTERA company fpga chip, programming languages, Verilog HDL, to achieve the DDS digital signal generator, can generate sine signal, triangle signal, rectangular signal
(系统自动生成,下载前可以参看下载内容)

下载文件列表

dds1

....\a.mif

....\accu.v

....\C51_Ctrl.v

....\C51_Ctrl.v.bak

....\clk_divider.v

....\db

....\..\altsyncram_1e71.tdf

....\..\altsyncram_6e91.tdf

....\..\altsyncram_6id1.tdf

....\..\altsyncram_8jb1.tdf

....\..\altsyncram_8qc2.tdf

....\..\altsyncram_dp61.tdf

....\..\altsyncram_ds61.tdf

....\..\altsyncram_ekb1.tdf

....\..\altsyncram_n571.tdf

....\..\altsyncram_nq61.tdf

....\..\altsyncram_oc71.tdf

....\..\altsyncram_oq61.tdf

....\..\altsyncram_tt61.tdf

....\..\altsyncram_uib1.tdf

....\..\dds1.asm.qmsg

....\..\dds1.asm_labs.ddb

....\..\dds1.cbx.xml

....\..\dds1.cmp.bpm

....\..\dds1.cmp.cdb

....\..\dds1.cmp.ecobp

....\..\dds1.cmp.hdb

....\..\dds1.cmp.logdb

....\..\dds1.cmp.rdb

....\..\dds1.cmp.tdb

....\..\dds1.cmp0.ddb

....\..\dds1.db_info

....\..\dds1.eco.cdb

....\..\dds1.fit.qmsg

....\..\dds1.hier_info

....\..\dds1.hif

....\..\dds1.map.bpm

....\..\dds1.map.cdb

....\..\dds1.map.ecobp

....\..\dds1.map.hdb

....\..\dds1.map.logdb

....\..\dds1.map.qmsg

....\..\dds1.map_bb.cdb

....\..\dds1.map_bb.hdb

....\..\dds1.map_bb.hdbx

....\..\dds1.map_bb.logdb

....\..\dds1.pre_map.cdb

....\..\dds1.pre_map.hdb

....\..\dds1.psp

....\..\dds1.root_partition.cmp.atm

....\..\dds1.root_partition.cmp.dfp

....\..\dds1.root_partition.cmp.hdbx

....\..\dds1.root_partition.cmp.logdb

....\..\dds1.root_partition.cmp.rcf

....\..\dds1.root_partition.map.atm

....\..\dds1.root_partition.map.hdbx

....\..\dds1.root_partition.map.info

....\..\dds1.root_partition.merge_hb.atm

....\..\dds1.rtlv.hdb

....\..\dds1.rtlv_sg.cdb

....\..\dds1.rtlv_sg_swap.cdb

....\..\dds1.sgdiff.cdb

....\..\dds1.sgdiff.hdb

....\..\dds1.signalprobe.cdb

....\..\dds1.sim.cvwf

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.cmp.atm

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.cmp.dfp

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.cmp.hdbx

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.cmp.logdb

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.map.atm

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.map.hdbx

....\..\dds1.sldhu_30e344a040fd07e1533c49de5f2d67d1.map.logdb

....\..\dds1.sld_design_entry.sci

....\..\dds1.sld_design_entry_dsc.sci

....\..\dds1.syn_hier_info

....\..\dds1.tan.qmsg

....\..\dds1.tis_db_list.ddb

....\..\dds1.tmw_info

....\..\decode_aoi.tdf

....\..\prev_cmp_dds1.asm.qmsg

....\..\prev_cmp_dds1.fit.qmsg

....\..\prev_cmp_dds1.map.qmsg

....\..\prev_cmp_dds1.qmsg

....\..\prev_cmp_dds1.sim.qmsg

....\..\prev_cmp_dds1.tan.qmsg

....\..\wed.wsf

....\dds.c

....\dds.LST

....\dds.OBJ

....\dds.Opt

....\dds.plg

....\dds.Uv2

....\dds.v

....\dds.v.bak

....\dds1

....\dds1.asm.rpt

....\dds1.cdf

....\dds1.done

....\dds1.dpf

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