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文件名称:weitb

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 582kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • dan***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

在数字通信中，通常直接从接收到的数字信号中提取位同步信号，这种直接法按其提取同步信号的方式，大致可分为滤波法和锁相法。锁相法是指利用锁相环来提取位同步信号的方法，本设计方案就是基于锁相环的位同步提取方法，能够比较快速地提取位同步时钟，并且设计简单，方便修改参数。采用Quartus II设计软件对系统进行了仿真试验，并用Altera的Cyclone II系列FPGA芯片Ep2c5予以实现。-In digital communication, usually from receiving directly in digital signal extracted a synchronized signal, the direct method according to the extraction synchronized signal way, can be roughly divided into filtering method and phase lock method. Phase lock method is using of phase locked loop to extract a synchronized signal method, the design scheme is based on phase locked loop of a synchronous extraction method and can be quickly extract a synchronous clock, and design simple, convenient modification parameter. The Quartus II design software of the system, and the simulation test Altera Cyclone II FPGA chip to achieve Ep2c5 series.
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(系统自动生成,下载前可以参看下载内容)

下载文件列表

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.....\and1.v

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.....\and_1.qip

.....\and_1.v

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.....\counter.qip

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.....\..\weitb.lpc.txt

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.....\..\weitb.map_bb.logdb

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.....\..\weitb.pre_map.hdb

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.....\..\weitb.sld_design_entry.sci

.....\..\weitb.sld_design_entry_dsc.sci

.....\..\weitb.smart_action.txt

.....\..\weitb.syn_hier_info

.....\..\weitb.tan.qmsg

.....\..\weitb.tis_db_list.ddb

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.....\dff.v

.....\dff_2.qip

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