文件名称:complete

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 235kb
  • 下载次数:
  • 0次
  • 提 供 者:
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介绍说明--下载内容均来自于网络,请自行研究使用

用Verilog编写的数字钟与汽车尾灯模块。其中数字钟具有时间显示的基本功能,按键校时校分,闹钟模块(包含校时校分),仿电台报时(四低一高),整点报时,12-24显示切换等强大功能。-With a digital clock in Verilog modules and automotive taillights. Digital clock which displays the basic functions of a time, school hours when school keys, alarm clock module (including school hours at school), imitation radio repeater (four low-high), the whole point timekeeping ,12-24 shows switching power.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

complete

........\LIB.DLS

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........\U3335266.DLS

........\U3549847.DLS

........\U3624144.DLS

........\U6202970.DLS

........\U6558480.DLS

........\U8537676.DLS

........\U8986837.DLS

........\U9858192.DLS

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........\counter10.hif

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........\final.hif

........\final.mmf

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........\final.sof

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........\final.v

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........\top_clock.hif

........\top_clock.v

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