文件名称:chap12

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 6kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • T**
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  • 下载说明:
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介绍说明--下载内容均来自于网络,请自行研究使用

本程序是关于学习VERILOG语言的案例,方便读者快速掌握VERILOG语言的基本语法,操作等-This program is about learning the language of the case VERILOG to allow readers to quickly master the basic syntax of the language VERILOG, operation, etc.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

chap12

......\add_ahead.v

......\add_bx.v

......\add_jl.v

......\add_tree.v

......\correlator.v

......\crc.v

......\cycle.v

......\decoder1.v

......\decoder2.v

......\fir.v

......\linear.v

......\mult.v

......\mult4x4.v

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