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文件名称:Adder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 2kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 李**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

VHDL语言设计的加法器，在试验箱上使用8个拨码开关设置要加的2个数，按键按下输出相加的结果，在试验箱上测试通过。-Adder VHDL language design, in the chamber using the DIP switch setting 8 to 2 to add the number of keys pressed result of the addition output of the chamber on the test.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

加法器0.txt

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