文件名称:PWM256
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Verilog 所寫的可程式 PWM 信號產生器. 特點是設定參數時不會產生Glitch現象. 包含二個 .do 檔給 model*sim 幫助編譯及模擬.-A PWM generator writing in Verilog. This module will generate glitch while changing the setting. Including 2 .do files which can help compiling and simulating in the model_sim.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
simpwm.do
cmppwm.do
pwm.v
cmppwm.do
pwm.v