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文件名称:XAPP134_SDRAM_Verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 292kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • j*
  • 相关连接：
  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

Xilinx XAPP134 SDRAM Verilog
相关搜索： xilinx
sdram

(系统自动生成,下载前可以参看下载内容)

下载文件列表

XAPP134_SDRAM_Verilog\verilog\func_sim\func_sim.cfg

.....................\.......\........\func_sim.log

.....................\.......\........\func_sim.vpd

.....................\.......\........\run_sim

.....................\.......\........\string_decode_fn.v

.....................\.......\........\tb_sdrm.v

.....................\.......\micron\bank0.txt

.....................\.......\......\bank1.txt

.....................\.......\......\mt48lc1m16a1-8a.v

.....................\.......\......\mt48lc1m16a1.v

.....................\.......\......\test.v

.....................\.......\par\run_par

.....................\.......\...\sdrm.edf

.....................\.......\...\sdrm.ucf

.....................\.......\...\sdrm_par.sdf

.....................\.......\...\sdrm_par.v

.....................\.......\.ost_route\post_route.cfg

.....................\.......\..........\post_route.log

.....................\.......\..........\post_route.vpd

.....................\.......\..........\run_sim

.....................\.......\..........\sdrm_par.sdf

.....................\.......\..........\sdrm_par.v

.....................\.......\..........\string_decode_post_route.v

.....................\.......\..........\tb_post_route.v

.....................\.......\README

.....................\.......\src\brst_cntr.v

.....................\.......\...\cslt_cntr.v

.....................\.......\...\define.v

.....................\.......\...\ki_cntr.v

.....................\.......\...\rcd_cntr.v

.....................\.......\...\ref_cntr.v

.....................\.......\...\sdrm.v

.....................\.......\...\sdrmc_state.v

.....................\.......\...\sdrm_t.v

.....................\.......\...\sys_int.v

.....................\.......\.ynth\run_synth

.....................\.......\.....\sdrm.edf

.....................\.......\.....\sdrm.scr

.....................\.......\.....\setup.scr

.....................\.......\func_sim

.....................\.......\micron

.....................\.......\par

.....................\.......\post_route

.....................\.......\src

.....................\.......\synth

.....................\verilog

XAPP134_SDRAM_Verilog

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