文件名称:mulhoulai
介绍说明－－下载内容均来自于网络，请自行研究使用
这是一个乘法器的Verilog实现，这是仿真AMR处理器核中的乘法器开发的。挺不错的。-It is a multiplier using the Verilog.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
mulhoulai\cellmix.v
.........\cellmix.v.bak
.........\mulhoulai.cr.mti
.........\mulhoulai.mpf
.........\test.v
.........\test.v.bak
.........\vsim.wlf
.........\work\@m@u@l\verilog.asm
.........\....\......\_primary.dat
.........\....\......\_primary.vhd
.........\....\.....x31\verilog.asm
.........\....\........\_primary.dat
.........\....\........\_primary.vhd
.........\....\........s\verilog.asm
.........\....\.........\_primary.dat
.........\....\.........\_primary.vhd
.........\....\......._1@s\verilog.asm
.........\....\...........\_primary.dat
.........\....\...........\_primary.vhd
.........\....\.s_@a@n@d2_27_12@s11\verilog.asm
.........\....\....................\_primary.dat
.........\....\....................\_primary.vhd
.........\....\..................3\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........54_27@d2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........69_36\verilog.asm
.........\....\................\_primary.dat
.........\....\................\_primary.vhd
.........\....\...........93_42@d3\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\.........3_111_54\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\...........54_24@d2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........81_39@d2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\.........4_18@x2_18\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........27@x2_24\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\............._12@s1\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\..................2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........39_15\verilog.asm
.........\....\................\_primary.dat
.........\....\................\_primary.vhd
.........\....\................@s1\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\..............21\verilog.asm
.........\....\................\_primary.dat
.........\....\................\_primary.vhd
.........\....\......o12@b1_27_27\verilog.asm
.........\....\..................\_primary.dat
.........\....\..................\_primary.vhd
.........\....\.......22_138_138\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\..........27_12\verilog.asm
.........\....\...............\_primary.dat
.........\....\...............\_primary.vhd
.........\....\........3_15_15\verilog.asm
.........\....\...............\_primary.dat
.........\....\...............\_primary.vhd
.........\....\.......32_36_36@d2\verilog.asm
.........\....\..................\_primary.dat
.........\....\..................\_primary.vhd
.........\....\.......@i21_54@x_24\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\.................@e54@s1\verilog.asm
.........\....\........................\_primary.dat
.........\....\........................\_primary.vhd
.........\....\.............._24\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\...............@e27@s1\verilog.asm
.........\....\......................\_primary.dat
.........\....\......................\_primary.vhd
.........\....\.................51\verilog.asm
.........\....\...................\_primary.dat
.........\....\....
.........\cellmix.v.bak
.........\mulhoulai.cr.mti
.........\mulhoulai.mpf
.........\test.v
.........\test.v.bak
.........\vsim.wlf
.........\work\@m@u@l\verilog.asm
.........\....\......\_primary.dat
.........\....\......\_primary.vhd
.........\....\.....x31\verilog.asm
.........\....\........\_primary.dat
.........\....\........\_primary.vhd
.........\....\........s\verilog.asm
.........\....\.........\_primary.dat
.........\....\.........\_primary.vhd
.........\....\......._1@s\verilog.asm
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.........\....\...........\_primary.vhd
.........\....\.s_@a@n@d2_27_12@s11\verilog.asm
.........\....\....................\_primary.dat
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.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........54_27@d2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........69_36\verilog.asm
.........\....\................\_primary.dat
.........\....\................\_primary.vhd
.........\....\...........93_42@d3\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\.........3_111_54\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\...........54_24@d2\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\...........81_39@d2\verilog.asm
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.........\....\............._12@s1\verilog.asm
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.........\....\..................\_primary.vhd
.........\....\.......22_138_138\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\..........27_12\verilog.asm
.........\....\...............\_primary.dat
.........\....\...............\_primary.vhd
.........\....\........3_15_15\verilog.asm
.........\....\...............\_primary.dat
.........\....\...............\_primary.vhd
.........\....\.......32_36_36@d2\verilog.asm
.........\....\..................\_primary.dat
.........\....\..................\_primary.vhd
.........\....\.......@i21_54@x_24\verilog.asm
.........\....\...................\_primary.dat
.........\....\...................\_primary.vhd
.........\....\.................@e54@s1\verilog.asm
.........\....\........................\_primary.dat
.........\....\........................\_primary.vhd
.........\....\.............._24\verilog.asm
.........\....\.................\_primary.dat
.........\....\.................\_primary.vhd
.........\....\...............@e27@s1\verilog.asm
.........\....\......................\_primary.dat
.........\....\......................\_primary.vhd
.........\....\.................51\verilog.asm
.........\....\...................\_primary.dat
.........\....\....