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文件名称:clock_generator

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 160kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • l**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

基于FPGA的时间转换器的一个ISE工程，使用verilog语音-Converter based on FPGA time a ISE project, use the verilog voice
(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock_generator\DCM1.xaw

...............\clock_generator_summary.html

...............\clock_generator.v

...............\clock_generator.restore

...............\clock_generator.ise_ISE_Backup

...............\clock_generator.ise

...............\clk_generator_summary.html

...............\_xmsgs

clock_generator

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