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文件名称:shuzishizhong

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 47kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用verilog语言写的数字时钟程序 芯片是EP2C8Q208C8-Verilog language used to write the digital clock program chip EP2C8Q208C8
相关搜索： 数字时钟

(系统自动生成,下载前可以参看下载内容)

下载文件列表

数字时钟\clock.asm.rpt

........\clock.cdf

........\clock.done

........\clock.dpf

........\clock.fit.eqn

........\clock.fit.rpt

........\clock.fit.smsg

........\clock.fit.summary

........\clock.flow.rpt

........\clock.map.eqn

........\clock.map.rpt

........\clock.map.summary

........\clock.pin

........\clock.pof

........\clock.qpf

........\clock.qsf

........\clock.tan.rpt

........\clock.tan.summary

........\clock.v

........\clock.v.bak

........\clock_assignment_defaults.qdf

........\cmp_state.ini

........\db\add_sub_bph.tdf

........\..\add_sub_onh.tdf

........\..\clock_cmp.qrpt

........\..\clock.db_info

........\..\clock.sld_design_entry.sci

........\..\clock.eco.cdb

........\clock.qws

........\db

数字时钟

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