文件名称:hex_vs_asic
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hex到asic,以及asic到hex的verilog转换模块，全组合逻辑，单周期完成。-hex to asic, as well as the asic to the hex of the verilog conversion module, the whole combination of logic, single-cycle completion.
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asic_hex.v
hex_asic.v
hex_asic.v