文件名称:ddrct_np_xm_3_005_1

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 651kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 董*
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

有关ddr控制设计的问题,ddrct_np_xm_3_005_1.zip,非常值得参考!
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ddrct_np_xm_3_005\default.css

.................\Readme.htm

.................\tutorial

.................\xm

.................\..\ver3

.................\..\....\eval

.................\..\....\....\readme.txt

.................\..\....\....\simulation

.................\..\....\....\..........\scripts

.................\..\....\....\..........\.......\eval_ddr_sim_verilog.do

.................\..\....\....\..........\.......\eval_ddr_sim_vhdl.do

.................\..\....\....\..........\verilog.log

.................\..\....\....\testbench

.................\..\....\....\.........\verilog

.................\..\....\....\.........\.......\ddr_top_tb.v

.................\..\....\....\.........\vhdl

.................\..\....\....\.........\....\ddr_top_tb.vhd

.................\..\....\....\tests

.................\..\....\....\.....\stimuli_basicrw_cmd.v

.................\..\....\gui_script

.................\..\....\..........\module_gen.zip

.................\..\....\lib

.................\..\....\...\modelsim

.................\..\....\...\........\IP_work

.................\..\....\...\........\.......\@b@b

.................\..\....\...\........\.......\....\verilog.psm

.................\..\....\...\........\.......\....\_primary.dat

.................\..\....\...\........\.......\....\_primary.vhd

.................\..\....\...\........\.......\@d@q@s@b@u@f@b

.................\..\....\...\........\.......\..............\verilog.psm

.................\..\....\...\........\.......\..............\_primary.dat

.................\..\....\...\........\.......\..............\_primary.vhd

.................\..\....\...\........\.......\@d@q@s@d@l@l

.................\..\....\...\........\.......\............\verilog.psm

.................\..\....\...\........\.......\............\_primary.dat

.................\..\....\...\........\.......\............\_primary.vhd

.................\..\....\...\........\.......\@e@h@x@p@l@l@b

.................\..\....\...\........\.......\..............\verilog.psm

.................\..\....\...\........\.......\..............\_primary.dat

.................\..\....\...\........\.......\..............\_primary.vhd

.................\..\....\...\........\.......\@g@s@r

.................\..\....\...\........\.......\......\verilog.psm

.................\..\....\...\........\.......\......\_primary.dat

.................\..\....\...\........\.......\......\_primary.vhd

.................\..\....\...\........\.......\@i@d@d@r@x@b

.................\..\....\...\........\.......\............\verilog.psm

.................\..\....\...\........\.......\............\_primary.dat

.................\..\....\...\........\.......\............\_primary.vhd

.................\..\....\...\........\.......\@o@d@d@r@x@b

.................\..\....\...\........\.......\............\verilog.psm

.................\..\....\...\........\.......\............\_primary.dat

.................\..\....\...\........\.......\............\_primary.vhd

.................\..\....\...\........\.......\@t@s@a@l@l

.................\..\....\...\........\.......\..........\verilog.psm

.................\..\....\...\........\.......\..........\_primary.dat

.................\..\....\...\........\.......\..........\_primary.vhd

.................\..\....\...\........\.......\@v@l@o

.................\..\....\...\........\.......\......\verilog.psm

.................\..\....\...\........\.......\......\_primary.dat

.................\..\....\...\........\.......\......\_primary.vhd

.................\..\....\...\........\.......\cal_dvgen

.................\..\....\...\........\.......\.........\verilog.psm

.................\..\....\...\........\.......\.........\_primary.dat

.................\..\....\...\........\.......\.........\_primary.vhd

.................\..\....\...\........\.......\data_valid_macro

.................\..\....\...\........\.......\................\verilog.psm

.................\..\....\...\........\.......\................\_primary.dat

.................\..\....\...\........\.......\................\_primary.vhd

.................\..\....\...\........\.......\dd

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