文件名称:wishbone_m4_s8
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wishbone 骨幹部份 RTL 源碼, 以verilog
寫成, 自創. 支源 4 master 及 8 slave-wishbone core, write by verilog, support
4 master and 8 slaver.
language: verilog.
寫成, 自創. 支源 4 master 及 8 slave-wishbone core, write by verilog, support
4 master and 8 slaver.
language: verilog.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
wishbone_m4_s8\wb_xbar_top.v
..............\wb_xbar_arb.v
wishbone_m4_s8
..............\wb_xbar_arb.v
wishbone_m4_s8