文件名称:CPU
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verilog编写CPU：
1. 哈佛存储器结构，大端格式；
2. 类MIPS精简指令集，支持子程序调用和软中断；
3. 实现了乘除法；
4. 五级流水线，工作频率可达80MHz（每个时钟周期一条指令，不计流水线冲突）。 -MIPS like CPU using verilog
1. 哈佛存储器结构，大端格式；
2. 类MIPS精简指令集，支持子程序调用和软中断；
3. 实现了乘除法；
4. 五级流水线，工作频率可达80MHz（每个时钟周期一条指令，不计流水线冲突）。 -MIPS like CPU using verilog
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下载文件列表
源代码\ALU.v
......\branchlogic.v
......\carry_save_mult.v
......\DataCycle.v
......\DataCycle1.v
......\decoder.v
......\divide1.v
......\div_array.v
......\membus.v
......\mux.v
......\Newdefine.h
......\newsignexpand.v
......\pc.v
......\pipeline.v
......\regfile.v
......\shifter32.v
......\test.v
......\timescale.v
源代码
......\branchlogic.v
......\carry_save_mult.v
......\DataCycle.v
......\DataCycle1.v
......\decoder.v
......\divide1.v
......\div_array.v
......\membus.v
......\mux.v
......\Newdefine.h
......\newsignexpand.v
......\pc.v
......\pipeline.v
......\regfile.v
......\shifter32.v
......\test.v
......\timescale.v
源代码