文件名称:nnARM_core

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 82kb
  • 下载次数:
  • 0次
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介绍说明--下载内容均来自于网络,请自行研究使用

nnARM核源代码,用verilog编写,请需要的朋友下来研究,不要用于商业用途-nnARM core source code, using verilog write, please study the needs of a friend down, not for commercial purposes
相关搜索: nnarm

(系统自动生成,下载前可以参看下载内容)

下载文件列表

nnARM_core\Adder.v

..........\ALUComb.v

..........\ALUShell.v

..........\tb_system.v

..........\BarrelShift.v

..........\README.TXT

..........\nnARMCore.v

..........\CanGoGen.v

..........\complementary.v

..........\Def_Decoder.v

..........\psr.v

..........\Def_StructureParameter.v

..........\Decoder_ARM.v

..........\Def_ALUType.v

..........\Def_ARMALU.v

..........\Def_BarrelShift.v

..........\Thumb_2_nnARM.v

..........\Def_ConditionField.v

..........\Def_DataCacheController.v

..........\Def_psr.v

..........\Def_InstructionCacheController.v

..........\Def_InstructionPreFetch.v

..........\Def_mem.v

..........\Def_MemoryController.v

..........\Def_Mode.v

..........\Def_RegisterFile.v

..........\Def_SimulationParameter.v

..........\ThumbDecoderWarper.v

..........\IF.v

..........\nnARM.prog

..........\mul.v

..........\mem.v

..........\timescalar.v

..........\nnARM1.v

..........\bak\System.v

..........\...\tb_Adder.v

..........\...\tb_BarrelShift.v

..........\...\tb_complementary.v

..........\...\tb_Decoder_ARM.v

..........\...\tb_IF.v

..........\...\tb_InstructionPreFetch.v

..........\...\tb_RegisterFile.v

..........\...\tb_tomasulo.v

..........\...\Arbitrator.v

..........\...\BusTransfer.v

..........\...\CacheMemory.v

..........\...\CAM.v

..........\...\datac2.v

..........\...\DataCacheMemory.v

..........\...\MemoryMux.v

..........\...\nnARM.v

..........\...\TestInstruction.v

..........\...\tb_system_fft.v

..........\...\scr.cmd

..........\...\Def_ComponentEntry.v

..........\...\nnARM11.v

..........\...\DataCacheController.v

..........\...\InstructionCacheController.v

..........\...\InstructionPreFetch.v

..........\...\MemoryController.v

..........\bak

..........\InterruptPriority.v

..........\Def_Exception.v

..........\PSR_Fresh.v

..........\MemoryController_WB_Beh.v

..........\D_Bus2Core.v

..........\I_Bus2Core.v

..........\scr1.cmd

..........\RegisterFile.v

..........\WishBone_Arbiter.v

..........\scr.cmd

..........\scr3.cmd

..........\nnARM.vpj

nnARM_core

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