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文件名称:fifo_32_4321

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 5kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • ke***
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  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用verilog写的输出数据宽度可变的FIFO,输入数据为32-bit，输出数据可以配置为4-1任意bit。有设计文件和testbench-Use verilog to write a variable width of the output data FIFO, input data for the 32-bit, output data can be configured as 4-1 arbitrary bit. There are design files and testbench
相关搜索： FIFO
verilog
fifo
verilog
testbench

(系统自动生成,下载前可以参看下载内容)

下载文件列表

fifo_32_4321

............\fifo_32_4321.v

............\tb_ff_32_4321.v

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