文件名称:auk_sdsdi
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用于FPGA设计的代码（Verilog代码），在FPGA设计中的高速串并转换，时钟提取，对齐处理等功能-for FPGA design ,written by Verilog HDL the functions include SERDES , CDR and so on
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下载文件列表
auk_sdsdi-v1.1
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..............\...\readme.txt
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..............\.......\sdsdi_rxtx_cyclone_board
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..............\...........\...\sdi_std_logic.vhd
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..............\...\readme.txt
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