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文件名称:fenpinqi

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 5kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 山*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog写的分频器，其最高频率为输入频率，没毛刺，挺好-written in verilog divider, the maximum frequency of input frequency, no glitches, very good
(系统自动生成,下载前可以参看下载内容)

下载文件列表

新建文件夹

..........\dclk1.bsf

..........\dclk1.v

..........\dclk2.bsf

..........\dclk2.v

..........\freq.bdf

..........\key.bsf

..........\key.v

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