文件名称:counter

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 2.46mb
  • 下载次数:
  • 0次
  • 提 供 者:
  • dou***
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

用Verilog HDL语言实现FPGA的频率等精度测量。(已经过验证)-Using Verilog HDL language, such as FPGA frequency measurement accuracy. (Has already been verified)
(系统自动生成,下载前可以参看下载内容)

下载文件列表

频率计(测周法)

..............\clk2.bsf

..............\clkgen.bsf

..............\clkgen.v

..............\control.v

..............\Counter.bsf

..............\Counter.v

..............\db

..............\..\add_sub_0fc.tdf

..............\..\add_sub_1fc.tdf

..............\..\add_sub_2fc.tdf

..............\..\add_sub_3dc.tdf

..............\..\add_sub_4dc.tdf

..............\..\add_sub_5dc.tdf

..............\..\add_sub_6dc.tdf

..............\..\add_sub_7dc.tdf

..............\..\add_sub_8dc.tdf

..............\..\add_sub_9dc.tdf

..............\..\add_sub_adc.tdf

..............\..\add_sub_bdc.tdf

..............\..\add_sub_i4h.tdf

..............\..\add_sub_j4h.tdf

..............\..\add_sub_jec.tdf

..............\..\add_sub_kec.tdf

..............\..\add_sub_lec.tdf

..............\..\add_sub_m4h.tdf

..............\..\add_sub_mac.tdf

..............\..\add_sub_mec.tdf

..............\..\add_sub_n4h.tdf

..............\..\add_sub_nac.tdf

..............\..\add_sub_nec.tdf

..............\..\add_sub_oec.tdf

..............\..\add_sub_pec.tdf

..............\..\add_sub_q4h.tdf

..............\..\add_sub_qec.tdf

..............\..\add_sub_rec.tdf

..............\..\add_sub_sec.tdf

..............\..\add_sub_tec.tdf

..............\..\add_sub_uec.tdf

..............\..\add_sub_vec.tdf

..............\..\alt_u_div_2ue.tdf

..............\..\alt_u_div_4ue.tdf

..............\..\FreCounter.asm.qmsg

..............\..\FreCounter.cbx.xml

..............\..\FreCounter.cmp.cdb

..............\..\FreCounter.cmp.hdb

..............\..\FreCounter.cmp.kpt

..............\..\FreCounter.cmp.logdb

..............\..\FreCounter.cmp.rdb

..............\..\FreCounter.cmp.tdb

..............\..\FreCounter.cmp0.ddb

..............\..\FreCounter.dbp

..............\..\FreCounter.db_info

..............\..\FreCounter.eco.cdb

..............\..\FreCounter.eds_overflow

..............\..\FreCounter.fit.qmsg

..............\..\FreCounter.hier_info

..............\..\FreCounter.hif

..............\..\FreCounter.map.cdb

..............\..\FreCounter.map.hdb

..............\..\FreCounter.map.logdb

..............\..\FreCounter.map.qmsg

..............\..\FreCounter.pre_map.cdb

..............\..\FreCounter.pre_map.hdb

..............\..\FreCounter.psp

..............\..\FreCounter.rtlv.hdb

..............\..\FreCounter.rtlv_sg.cdb

..............\..\FreCounter.rtlv_sg_swap.cdb

..............\..\FreCounter.sgdiff.cdb

..............\..\FreCounter.sgdiff.hdb

..............\..\FreCounter.signalprobe.cdb

..............\..\FreCounter.sim.hdb

..............\..\FreCounter.sim.qmsg

..............\..\FreCounter.sim.rdb

..............\..\FreCounter.sim.vwf

..............\..\FreCounter.sld_design_entry.sci

..............\..\FreCounter.sld_design_entry_dsc.sci

..............\..\FreCounter.syn_hier_info

..............\..\FreCounter.tan.qmsg

..............\..\lpm_divide_d8m.tdf

..............\..\lpm_divide_e8m.tdf

..............\..\sign_div_unsign_9nh.tdf

..............\..\sign_div_unsign_anh.tdf

..............\..\wed.zsf

..............\D_ff.bsf

..............\D_ff.v

..............\d_latch.bsf

..............\d_latch.v

..............\FreCounter.asm.rpt

..............\FreCounter.cdf

..............\FreCounter.done

..............\FreCounter.fit.rpt

..............\FreCounter.fit.smsg

..............\FreCounter.fit.summary

..............\FreCounter.flow.rpt

..............\FreCounter.gdf

..............\FreCounter.map.rpt

..............\FreCounter.map.summary

..............\FreCounter.pin

..............\FreCounter.pof

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