文件名称:FPGApro

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  • [ASM] [源码]
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VERILOG HDL 实际工控项目源码

开发工具 altera quartus2-verilog HDL actual industrial projects source development tools altera quartus2
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FPGApro\myfifo.qsf
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FPGApro\myfifo.eda.rpt
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FPGApro\myfifo.qws
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FPGApro\myfifo.cdf
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FPGApro\myfifo.jam
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FPGApro\ram.v
FPGApro\addr_code.v
FPGApro\ram_all.bdf
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FPGApro\ram_all.v
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FPGApro\sopc_builder_debug_log.txt
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FPGApro\pan.v
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FPGApro\myfifo.rbf
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FPGApro\ram.v.bak
FPGApro\mydram.v
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FPGApro\db\myfifo.tan.qmsg
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FPGApro\db\myfifo.eda.qmsg
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