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文件名称:7

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 5kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 郭*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

王金明verilog第7章

适合初学者-Wang Jinming verilog Chapter 7 for beginners
(系统自动生成,下载前可以参看下载内容)

下载文件列表

chap7

.....\add4_1.v

.....\add4_2.v

.....\add4_3.v

.....\count4.v

.....\full_add1.v

.....\full_add2.v

.....\full_add3.v

.....\full_add4.v

.....\full_add5.v

.....\half_add1.v

.....\half_add2.v

.....\half_add3.v

.....\half_add4.v

.....\mux2_1a.v

.....\mux2_1b.v

.....\mux2_1c.v

.....\mux4_1a.v

.....\mux4_1b.v

.....\mux4_1c.v

.....\mux4_1d.v

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