文件名称:SHUZIMIAOBIAO

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [WORD]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 6kb
  • 下载次数:
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秒表的逻辑结构比较简单,它主要由、显示译码器、分频器、十进制计数器、报警器和六进制计数器组成。在整个秒表中最关键是如何获得一个精确的100Hz计时脉冲,除此之外,整个秒表还需要一个启动信号和一个归零信号,以便能够随时启动及停止。

秒表有六个输出显示,分别为百分之一秒,十分之一秒、秒、十秒、分、十分,所以共有6个计数器与之对应,6个个计数器全为BCD码输出,这样便于同时显示译码器的连接。当计时达60分钟后,蜂鸣器鸣响10声。

-Stopwatch logical structure is relatively simple, it mainly shows decoder, prescaler, decimal counter, alarm and six counter-band components. Throughout the stopwatch the most critical is how to get an accurate pulse 100Hz time, in addition, a whole also need a stopwatch start signal and a zero signal, in order to be able to start and stop at any time. Stopwatch six output shows that were hundredth of a second, one-tenth of seconds, seconds, 10 seconds, hours, very, so a total of six counters corresponding, 6 all counter-wide code for BCD output, making it easier for At the same time show decoder connections. When the time up to 60 minutes later, the buzzer sound of ringing 10.
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