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文件名称:clock

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 514kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • zzw***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

原创：基于VHDL语言编写的电子钟。采用模块化编写，可以调整时间，采用动态扫描显示时分秒-Original: Based on the VHDL language electronic bell. Modular prepared, you can adjust the time, dynamic scanning is displayed every minute
相关搜索： vhdl
clock

(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock

.....\bcd_decoder.bsf

.....\bcd_decoder.vhd

.....\clock.asm.rpt

.....\clock.bdf

.....\clock.done

.....\clock.dpf

.....\clock.fit.eqn

.....\clock.fit.rpt

.....\clock.fit.summary

.....\clock.fld

.....\clock.flow.rpt

.....\clock.map.eqn

.....\clock.map.rpt

.....\clock.map.summary

.....\clock.pin

.....\clock.pof

.....\clock.qpf

.....\clock.qsf

.....\clock.qws

.....\clock.sim.rpt

.....\clock.sof

.....\clock.tan.rpt

.....\clock.tan.summary

.....\clock.vhd

.....\clock.vwf

.....\counter24.bsf

.....\counter24.vhd

.....\counter24.vwf

.....\counter60.bsf

.....\counter60.vhd

.....\db

.....\..\clock.asm.qmsg

.....\..\clock.asm_labs.ddb

.....\..\clock.cbx.xml

.....\..\clock.cmp.cdb

.....\..\clock.cmp.hdb

.....\..\clock.cmp.logdb

.....\..\clock.cmp.qrpt

.....\..\clock.cmp.rdb

.....\..\clock.cmp.tdb

.....\..\clock.cmp0.ddb

.....\..\clock.cmp2.ddb

.....\..\clock.dbp

.....\..\clock.db_info

.....\..\clock.eco.cdb

.....\..\clock.eds_overflow

.....\..\clock.fit.qmsg

.....\..\clock.hier_info

.....\..\clock.hif

.....\..\clock.map.cdb

.....\..\clock.map.hdb

.....\..\clock.map.logdb

.....\..\clock.map.qmsg

.....\..\clock.pre_map.cdb

.....\..\clock.pre_map.hdb

.....\..\clock.psp

.....\..\clock.rpp.qmsg

.....\..\clock.rtlv.hdb

.....\..\clock.rtlv_sg.cdb

.....\..\clock.rtlv_sg_swap.cdb

.....\..\clock.sgate.rvd

.....\..\clock.sgate_sm.rvd

.....\..\clock.sgdiff.cdb

.....\..\clock.sgdiff.hdb

.....\..\clock.signalprobe.cdb

.....\..\clock.sim.hdb

.....\..\clock.sim.qmsg

.....\..\clock.sim.qrpt

.....\..\clock.sim.rdb

.....\..\clock.sim.vwf

.....\..\clock.sld_design_entry.sci

.....\..\clock.sld_design_entry_dsc.sci

.....\..\clock.syn_hier_info

.....\..\clock.tan.qmsg

.....\disp.bsf

.....\disp.vhd

.....\div_clock.bsf

.....\div_clock.vhd

.....\sel_mode.bsf

.....\sel_mode.vhd

.....\talkback

.....\........\clock.asm.talkback.xml

.....\........\clock.fit.talkback.xml

.....\........\clock.map.talkback.xml

.....\........\clock.rpp.talkback.xml

.....\........\clock.sim.talkback.xml

.....\........\clock.tan.talkback.xml

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