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  1. verilog_shili

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  2. 计数器 锁存器 12位寄存器 带load,clr等功能的寄存器 双向脚(clocked bidirectional pin) 一个简单的状态机 一个同步状态机 用状态机设计的交通灯控制器 数据接口 一个简单的UART 测试向量(Test Bench)举例: 加法器源程序 相应加法器的测试向量test bench)
  3. 所属分类:其它资源

    • 发布日期:2008-10-13
    • 文件大小:11.17kb
    • 提供者:李进来
  1. verilog_shili

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  2. 计数器 锁存器 12位寄存器 带load,clr等功能的寄存器 双向脚(clocked bidirectional pin) 一个简单的状态机 一个同步状态机 用状态机设计的交通灯控制器 数据接口 一个简单的UART 测试向量(Test Bench)举例: 加法器源程序 相应加法器的测试向量test bench)-Counter latch 12 registers with load, cl
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-24
    • 文件大小:11kb
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