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adma.tar
- 基于AMBA规范的总线VERILOG HDL 源代码-Based on the AMBA bus specification VERILOG HDL source code
CODE
- AHB总线下的slave ram的verilog代码-AHB bus slave ram verilog
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- SystemC写的AMBA 3.0 AXI总线事物级TLM模型 正在调试。有详细实验报告说明。-AMBA 3.0 AXI TLM SystemsC
USB2.0
- USB2.0行为级描述，挂接在AMBA AXI总线上-USB2.0 RTL discr iption
AMBA-AXI
- ARM 内核总线的介绍。学习一下可以更加容易掌握ARM的知识-ARM core-bus introduction. And study how to more easily grasp the knowledge of ARM
AMBA-Specification-Rev-2.0
- AMBA2.0总线协议详细介绍，共230叶英文资料-AMBA2.0 bus protocol details, a total of 230 leaves information in English
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- ZedBoard学习手记（二） 开发自定义AXI总线外设IP核——以LED和开关为例 -ZedBoard learning s note (2) develop a custom AXI bus peripherals for leds and switch IP core- for example
Micrium_Microblaze_uCOS-II-AXI
- 支持xilinx ise designer 14.x的microblaze AXI总线 ucosii操作系统。-Support xilinx ise designer 14.x for microblaze AXI bus ucosii operating system
axi_master_latest.tar
- axi 总线 设计 和 仿真， 可以在设计中直接运动， 提供完整源代码和仿真文件， 用vhdl 语言实现。-axi bus design and simulation, you can directly exercise in design, providing full source code and simulation files, using vhdl language.
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- AXI 总线的SPI IP核说明书，需要的可以看一下。对于研究SPI 总线很有益处。-SPI IP Core Introduction
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- 满足axi总线的读写操作，实现数据的高速传输，实现ps端与拍了端的通信-axi read and write operations
ddr_top
- verilog语言ddr3读写程序，axi总线协议，用于ddr3读写测试-ddr3 read and write
axi_lite_user
- axi_lite_user官方样例，精简功能，适用于zynq系列axi总线(Axi_lite_user official sample, streamline function, apply to zynq series Axi bus)
AXI slave
- 使用verilog语言实现了AXI总线通信协议的从机部分(The slave part of AXI bus communication protocol is realized by using Verilog language)
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- xilinx Zynq 中的AXI总线 axi slaver模块(AXI bus Axi slaver module in Xilinx Zynq)
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- xilinx7系列芯片cdma的使用，axi总线接口，包括SG模式(the cdma of xilinx zynq7)
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- emif 接口转axi总线,测试功能正常使用，不包含仿真文件(EMIF interface to Axi bus, test function is in normal use, does not contain simulation files)
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- APB总线转SPI接口模块SV代码以及AXI总线转SPI接口模块SV代码(SV code of APB bus to SPI interface module and SV code of Axi bus to SPI interface module)