搜索资源列表
ADDER8B
- 8位加法器VHDL 8位加法器VHDL-eight Adder VHDL e ight Adder VHDL eight Adder VHDL 8 Adder VHDL
adder8b
- 本程序是利用两个4位二进制并行加法器通过级联方式构成一个8位加法器。
ADDER8B
- 8位加法器VHDL 8位加法器VHDL-eight Adder VHDL e ight Adder VHDL eight Adder VHDL 8 Adder VHDL
adder8b
- 本程序是利用两个4位二进制并行加法器通过级联方式构成一个8位加法器。-This procedure is to use two four parallel binary adder cascade manner through an 8-bit adder.
adder8b
- 用VHDL设计一个八位并行加法器，该八位并行加法器是有两个四位二进制并行加法器通过级联而成，先设计两个四位二进制并行加法器分别表示八位数中的低四位和高四位以及其加法（含进位），再将两个四位并行加法器级联成一个八位并行加法器。这种方法原理简单，资源利用率和进位速度方面都比较好。-VHDL language
DDSsheji
- 再发一个修改的完善的基于FPGA的DDS信号源实现方案-Recurrence of an amendment to improve the FPGA-based realization of the DDS signal source program
adder8b
- vhdl实现8位并行加法器，带进位，仿真没问题。-vhdl achieve 8-bit parallel adder with Carry the simulation no problem.
ADDER8B
- 用VHDL描述了八位加法器，并通过波形仿真验证其正确性-Described in VHDL eight adder and verify its correctness by means of simulation waveform
ADDER8B
- 8位加法器设计，包含源程序，仿真，用quartus 2打开-a 8 bit add