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  1. 2FSK2psk

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  2. 2FSK2PSK-二进制频移键控和相移键控信号发生器的源程序,是基于QUARTUS II软件平台,使用VHDL语言-2FSK2PSK-binary frequency shift keying and phase shift keying signal generator source, QUARTUS II is based on the software platform, the use of VHDL
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:1kb
    • 提供者:张全文
  1. Triangle_Wave_generater

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  2. 采用vhdl语言编程,基于quartus平台的三角波仿真。-Using VHDL language programming, based on the Quartus triangular wave simulation platform.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:1.93mb
    • 提供者:苏苏
  1. ff

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  2. QUARTUS II平台上的基于VHDL语言的电梯系统控制程序。-QUARTUS II platform based on the VHDL language elevator system control procedures.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:253kb
    • 提供者:凌丽
  1. DE2_NIOS_HOST_MOUSE_VGA

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  2. 在ALTERA的DE2开发板上做的关于HOST_MOUSE的例子,基于Quartus II 和SOPC Builder以及Nios II IDE平台所完成!-ALTERA development in the DE2 board to do on HOST_MOUSE example, based on the Quartus II and SOPC Builder and Nios II IDE platform completed!
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2024-11-30
    • 文件大小:1.79mb
    • 提供者:liguoyin
  1. LED

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  2. 在ALTERA的DE 2 开发板上做的一个类似闪烁的彩灯,用了16个LEDR,可以直接下载到板子上运行,基于经典的开发平台Quartus II+SOPC Builder+Nios II IDE 做的,只要看了以后,你就会自己设计各种花样的彩灯闪烁的样子了.所用语言有多种,VHDL,C/C++等-DE 2 in the development of the ALTERA board to do a similar flickering l
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2024-11-30
    • 文件大小:4.01mb
    • 提供者:liguoyin
  1. electricdesign

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  2. 用硬件电路实现简单音乐播放,基于Quartus平台。-The hardware circuit with simple music player, based on Quartus platform.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:373kb
    • 提供者:Fantasy
  1. step

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  2. 基于Quartus开发平台的3相6拍的步进电机-Quartus development platform based on the three-phase stepper motor 6 shooting. . . . . . . . . . . . .
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:442kb
    • 提供者:Fantasy
  1. MIMASUO

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  2. 伴随着集成电路(IC)技术的发展,EDA技术已经成为现代电子设计的发展趋势,并在各大公司、企事业单位和科研教学部门广泛使用。VHDL是一种全方位的硬件描述语言,几乎覆盖了以往各种硬件描述语言的功能,整个自顶向下或自底向上的电路设计过程都可以用VHDL来完成。本文阐述了EDA的概念和发展、VHDL语言的优点和语法结构并分析讲解了智能抢答器的各模块的功能要求、基本原理以及实现方法。本系统的设计就是采用VHDL硬件描述语言编程,基于Quart
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:175kb
    • 提供者:RONG
  1. danzhouqiCPU

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  2. VHDL单周期CPU设计,基于Quartus II 开发平台-VHDL single-cycle CPU design, Quartus II development platform based on
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:1.51mb
    • 提供者:逆天之刃
  1. elevatorverilog

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  2. VHDL 3层电梯控制器的设计,基于Quartus II平台-VHDL 3 story elevator controller design, based on the platform of Quartus II
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:74kb
    • 提供者:逆天之刃
  1. FIFO

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  2. 基于Quartus平台利用SDRAM芯片设计FIFO 使数据能够高速写入 低速读出-Quartus platform based on the use of SDRAM chip design data to enable high-speed FIFO read write speed
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:27kb
    • 提供者:邬储
  1. altera_sdram

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  2. 基于quartus平台的sdram控制器设计(verilog 源码)-Based on the the quartus platform, the SDRAM controller design (Verilog source code)
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:8.36mb
    • 提供者:guotao
  1. duozhouqiCPU

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  2. VHDL 多周期CPU设计。基于Quartus II平台-VHDL design of multi-cycle CPU. Quartus II-based platforms
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:22.75mb
    • 提供者:逆天之刃
  1. liushuixianCPU

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  2. VHDL 流水线CPU的设计,基于Quartus II平台-VHDL design of pipelined CPU based on Quartus II platform
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:2.53mb
    • 提供者:逆天之刃
  1. ARM32registergroup

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  2. VHDL ARM 32位寄存器组的设计,基于Quartus II平台-VHDL ARM 32-bit register set design, based on the platform of Quartus II
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:2.93mb
    • 提供者:逆天之刃
  1. Card_Seller

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  2. 基于VHDL语言的自动电话卡贩卖机的代码,在Altera的Quartus平台上编译通过。-Automated phone card vending machine code, based on VHDL Altera' s Quartus platform, compile.
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:1.22mb
    • 提供者:Zhiheng Shen
  1. 1

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  2. 一触即发 好玩的效果,基于quartus平台编写(This is a course work, showing some interesting results, welcome to download the exchange)
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:588kb
    • 提供者:1101
  1. project2

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  2. 基于Verilog在quartus平台上搭建的串口通信模型,适用于初学者。本实验所用RXD的波特率为9600,TXD波特率为9600×16,1位起始位,8位数据位(ASCII码),1位停止位,无奇偶校检位。接收数据时,至少连续采样8个周期都是“0”后,才认定为起始位,之后每隔16个周期取一次数据。(Verilog based on the quartus platform to build a serial communication
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:114kb
    • 提供者:锂离子
  1. wei

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  2. 实现位同步提取的代码部分,使用Verilog语言编程。(Implementing the code part of the bit synchronization extraction)
  3. 所属分类:其他小程序

    • 发布日期:2024-11-30
    • 文件大小:1kb
    • 提供者:HypnosX
  1. 实验九 计算机核心(CPU+RAM)的设计与实现

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  2. 计算机组成原理的CPU实验,基于quartus平台(CPU experiment of computer organization principle, based on quartus platform)
  3. 所属分类:VHDL编程

    • 发布日期:2024-11-30
    • 文件大小:3.21mb
    • 提供者:丁丫头
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