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Verilog-Semantics
- Synthesizable Verilo---syntax and semantics一本很好的关于verilog可综合设计的参考书-Synthesizable Verilo --- syntax and semantics a good Verilog synthesis of the reference design
verilog
- 小例子,关于Verilog HDL语言的一些小练习,可供参考.
Verilog
- 给大家一些关于VERILOG方面的学习以及练习的资料 主要是代码 希望大家喜欢
example.verilog.pdf
- 关于verilog的大量例子，通过这些例子的掌握，可以设计任何常用的程序。
夏宇闻-Verilog经典教程.pdf
- 关于verilog的经典教程，大多数初学者的首选教程。夏宇闻老师多年HDL设计的经验总结。
Verilog-Semantics
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xia
- 关于verilog的书,大家看看.初学者,看看很有帮助.-Verilog on the book, see. Beginners see very helpful.
ccd-in-verilog
- ALTERA关于CCD的一些verilog程序，都通过运行无误的。-ALTERA on a number of Verilog CCD procedures, both by running unmistakable.
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- 小例子,关于Verilog HDL语言的一些小练习,可供参考.-Small example, on the Verilog HDL language, some small exercises, for reference.
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- 这里有verilog的好书,关于怎么入门,不能错过啊 -Verilog has the book here on how entry, should not miss ah
Verilog
- 给大家一些关于VERILOG方面的学习以及练习的资料 主要是代码 希望大家喜欢-To everyone on the Verilog learning and practice of information is the code hope that everyone likes
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- 给大家上传一本非常好的关于verilog-hdl的电子书，实用，易懂，易学。此为第一章-Give us a very good upload on verilog-hdl of e-books, practical, easy-to-understand, easy to learn. This is the first chapter
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- 给大家上传一本非常好的关于verilog-hdl的电子书，实用，易懂，易学。此为第九章---结构建模-Give us a very good upload on verilog-hdl of e-books, practical, easy-to-understand, easy to learn. This is Chapter IX--- Structural Modeling
VERILOGCOURSE
- 关于verilog硬件描述语言的讲经典教程，能使初学者很好地掌握利用该语言设计源程序-On the Verilog hardware descr iption language speakers classic tutorial that will enable beginners to grasp a very good use of the language design source
example.verilog.pdf
- 关于verilog的大量例子，通过这些例子的掌握，可以设计任何常用的程序。-On a large number of examples of Verilog, through mastery of these examples, you can design any commonly used procedures.
verilog
- 一个很好的关于verilog的PPT 第1章 EDA设计与Verilog HDL语言概述 第2章 Verilog HDL基础与开发平台操作指南 第3章 Verilog HDL程序结构 第4章 VERILOG HDL语言基本要素 第5章 面向综合的行为描述语句 第6章 面向验证和仿真的行为描述语句 第7章 系统任务和编译预处理语句 第8章 VERILOG HDL可综合设计的难点解析 第9章 高级逻辑设计
Verilog-HDL
- 这是关于VERILOG HDL的有限状态机的源码，大家参考参考，应该有好处的。-This is about VERILOG HDL source code for finite state machines, we refer to the reference, it should be good.
关于timescale的用法
- 关于verilog timescale的解释(verilog)
verilog_clf
- 关于verilog clf 的说明(clf)