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文件名称:newViterbi217

  • 所属分类：
  • 邮电通讯系统
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2013-01-14
  • 文件大小：
  • 18kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • lo***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

基于IEEE802.11n标准,采用verilog语言设计的(2,1,7)卷积码viterbi译码器,支持1/2,2/3,3/4,5/6四种码率的译码,以测试无误-IEEE802.11n standard Verilog language design (2,1,7) convolutional code viterbi decoder support 1/2, 2/3, 3/4, 5/6 four bit rate decoding to test and correct
(系统自动生成,下载前可以参看下载内容)

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acsadd.v

acsCombine.v

acsCompare.v

acsunit.v

distance.v

dRam.v

smaller.v

tb_trace.v

viterbi.v

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