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VHDL编程
]
SDH
说明:SDH vhdl实现-SDH VHDL
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real
> 在 2025-01-31 上传 | 大小:
171kb
| 下载:
0
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VHDL编程
]
tel
说明:电话用户信令控制器的VHDL实现-Telephone subscriber signaling controller based on VHDL
<
real
> 在 2025-01-31 上传 | 大小:
36kb
| 下载:
0
[
VHDL编程
]
PCM
说明:PCM码流时隙信号产生模块的VHDL实现-PCM stream slot signal generation module based on VHDL
<
real
> 在 2025-01-31 上传 | 大小:
33kb
| 下载:
0
[
VHDL编程
]
decoder
说明:七段译码器的VHDL实现-The seven segment decoder implementations of VHDL
<
real
> 在 2025-01-31 上传 | 大小:
32kb
| 下载:
0
[
VHDL编程
]
check
说明: 11100 码流检测模块的VHDL实现- 11100 stream detection module based on VHDL
<
real
> 在 2025-01-31 上传 | 大小:
35kb
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[
VHDL编程
]
counter
说明:异步复位的十进制计数器-Decade counter with asynchronous reset
<
real
> 在 2025-01-31 上传 | 大小:
32kb
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0
[
VHDL编程
]
test2
说明:此程序为汉字“正”的源程序,仅仅用于学习和交流使用,不当之处,望指正!-This program is the Chinese character " positive" the source, use only for learning and communication, inappropriate, hope correction!
<
cc
> 在 2025-01-31 上传 | 大小:
1kb
| 下载:
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VHDL编程
]
main
说明:demux impelementation for vhdl muxing protocol
<
lst__0
> 在 2025-01-31 上传 | 大小:
3kb
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[
VHDL编程
]
1
说明:信号发生器VHDL实现,实现一种信号的产生-Signal generator VHDL implementation to achieve produce a signal
<
mike
> 在 2025-01-31 上传 | 大小:
1kb
| 下载:
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VHDL编程
]
DE2_Default-source
说明:Altera FPGA DE2 Default Project File
<
koko
> 在 2025-01-31 上传 | 大小:
150kb
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VHDL编程
]
core
说明:串转并的电路转换器,并包含testbench。-The converter circuit about serial to parrel, including testbench.
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Dante.W
> 在 2025-01-31 上传 | 大小:
1kb
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VHDL编程
]
DOT_LED
说明:点亮LED,适用于FPGA 初学者,很不错的例子,简单、易懂-dot led
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leo
> 在 2025-01-31 上传 | 大小:
1kb
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