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[VHDL编程48_4.12

说明:网络通信中的MII接口 通常将4位nibble数据送出,此程序将4位数据组合成8位数据并行输出(8比特==1个字节)。。完全可用 同时包含84转换-The MII network interface usually sent four nibble data, this procedure will be 4-bit data into 8-bit parallel output data (8 bits == 1 byte).
<王鹏> 在 2024-11-20 上传 | 大小:2kb | 下载:0

[VHDL编程EPM1270_adder

说明:vhdl 学习基础实例,有利于VHDL入门很有帮助-A good example for VHDL study.
<王新明> 在 2024-11-20 上传 | 大小:164kb | 下载:0

[VHDL编程EPM1270_comparator

说明:vhdl 基础例程,比较器,有利于VHDL入门学习-A good example for VHDL study
<王新明> 在 2024-11-20 上传 | 大小:94kb | 下载:0

[VHDL编程EPM1270_multiplier

说明:VHDL 乘法器 源代码,很好的VHDL 入门学习例程序-Multiplier VHDL source code, a good learning example VHDL entry procedures
<王新明> 在 2024-11-20 上传 | 大小:182kb | 下载:0

[VHDL编程dpll

说明:dpll的verilog代码,完成数字锁相。用于时钟对准,位同步。-dpll the verilog code to complete the digital phase-locked. Alignment for the clock, bit synchronization.
<hsj> 在 2024-11-20 上传 | 大小:1kb | 下载:0

[VHDL编程sdramled

说明:alter FPGA,包含sdram的nios系统开发实验完整工程文件-nios develop based nios IDE6.0,system involved an sdram
<吴波> 在 2024-11-20 上传 | 大小:1.35mb | 下载:0

[VHDL编程Verilog_coding_study

说明:verilog coding study book ---) -verilog coding study book---)
<rex> 在 2024-11-20 上传 | 大小:6.64mb | 下载:0

[VHDL编程juzhenjianpan

说明:本源码用VHDL语言实现了用键盘控制米字管显示十进制-VHDL
<黄秋华> 在 2024-11-20 上传 | 大小:214kb | 下载:0

[VHDL编程generic_testbench

说明:VHDL中关于generic的用法,及其testbench,可以使用Modelsim仿真查看其功能-the usage of generic,a testbench file is given, we can use it to simulate the generic s function
<xietianjiao> 在 2024-11-20 上传 | 大小:2kb | 下载:0

[VHDL编程the_VHDL_programe_of_generate_RAM

说明:一个产生RAM的VHDL代码,使用这个程序不需要调用系统的RAM,可以对这个代码进行适当的修改,以提高RAM的速度-the VHDL programe of generate RAM
<xietianjiao> 在 2024-11-20 上传 | 大小:2kb | 下载:0

[VHDL编程gcd_disp

说明:一个gcd_disp VHDL程序,速度很快-a VHDL program of gcd_disp with rapid speed
<xietianjiao> 在 2024-11-20 上传 | 大小:3kb | 下载:0

[VHDL编程float_data_multiple_use_fixed_pipeline_verilog_pro

说明:采用fpga做小数运算的程序,使用了三级流水线技术,这是学习流水线和定点小数乘法很好的例子!-a program of float multiply, using 3-stage pipeline technology
<xietianjiao> 在 2024-11-20 上传 | 大小:1kb | 下载:0
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