[VHDL编程] adc12d1000_rfrb

说明：ADC12D800 source code
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[VHDL编程] rgstr

说明：ADC12D800 source code
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[VHDL编程] dcm100

说明：ADC12D800 source code
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[VHDL编程] an489

说明：用于MAXII系列EPM240T100 CPLD中UMF使用的例程及说明文档-Routines and documentation for MAXII series CPLD used in UMF
<1zs> 在 2025-01-23 上传 | 大小：611kb | 下载：0

[VHDL编程] fir16.v

说明：16阶FIR滤波器设计的verilog代码-Verilog 16-order FIR filter
<lijinpeng> 在 2025-01-23 上传 | 大小：1kb | 下载：0

[VHDL编程] fir48

说明：48阶FIR滤波器的verilog，包含测试文件-48-order FIR filter verilog, including test paper
<lijinpeng> 在 2025-01-23 上传 | 大小：2kb | 下载：0

[VHDL编程] simple

说明： 一个简单的8位处理器完整设计过程及verilog代码,适合初 学ic设计的人用，并含有我个人写的指令执行过程，仅供参 考-A simple 8-bit processor and the complete design process verilog code, suitable for beginners ic design for human use, and contains my personal writing
<lijinpeng> 在 2025-01-23 上传 | 大小：80kb | 下载：0

[VHDL编程] DE1_D5M

说明：// --- --- --- --- --- --- --- --- --- --- --- -- // Copyright (c) 2007 by Terasic Technologies Inc. // -------------------------------------------------------------------- // // Permission: // // Terasic gr
<len> 在 2025-01-23 上传 | 大小：4kb | 下载：0

[VHDL编程] da2c

说明：VHDL硬件描述语言实现DA转化-In quurtus call half adder to achieve 16-bit serial adder
<lemony> 在 2025-01-23 上传 | 大小：3kb | 下载：0

[VHDL编程] pipeline_mips_simulation_using_xilinx

说明：This project is a pipeline simulator using xilinx. All of fetch, decode, execute and write back stages was implemented. That is a nice project for computer architecture course in computer engineering. Good Luck ) -Th
<Fartab> 在 2025-01-23 上传 | 大小：729kb | 下载：0

[VHDL编程] digital_timer

说明：能够使用4个按键，实现调时。一个选择，一个取消，一个加时间，一个减时间。-Four keys to use to achieve the transfer. A selection, a cancel an add time, a reduced time.
<lee> 在 2025-01-23 上传 | 大小：1.78mb | 下载：0

[VHDL编程] liushuideng

说明：verilog做的流水灯，分频器做半秒的tc，流水灯每半秒流动一次 -verilog do water lights, dividers do half a second tc, light water flow once every half-second
<grace> 在 2025-01-23 上传 | 大小：265kb | 下载：0