说明：在fpga中对于pll无法完成的分频，可采用计数方式，本例用状态机实现对时钟的奇数分频。-Pll in fpga can not be completed in the sub-frequency counting method can be used, in this case with the state machine to achieve an odd number on the clock frequency. <郝强> 在 2025-02-27 上传
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说明：本代码在fpga中实现了dds，程序有三个按键：一个控制产生的波形（正弦波或方波），另两个控制频率增加或降低。程序附有注释，并在signaltap中仿真成功。-The code is implemented in fpga a dds, program has three buttons: a control generated waveform (sine or square wave), the other two control <郝强> 在 2025-02-27 上传
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说明：一个基于VHDL的多功能数字钟设计，能在LCD上显示时间，调整时间，整点报时，音乐为美妙的梁祝。-A VHDL-based design of multi-functional digital clock that can display time in the LCD, adjust the time, the whole point of time, music was wonderful Butterfly Lovers. <周殿凤> 在 2025-02-27 上传
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说明：基于VHDL的各种流水灯的显示，程序简洁，占用资源少-VHDL-based light display a variety of water, the program simple and less resource <周殿凤> 在 2025-02-27 上传
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说明：基于VHDL的液晶动态显示，完整的Quartusii编程，初学者入门好帮手，读者打开即可使用-VHDL-based LCD dynamic display, complete Quartusii programming, a good helper for beginners entry, readers can use to open <周殿凤> 在 2025-02-27 上传
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说明：基于VHDL的乐曲演奏电路，完整的Quartusii编程，经测试完全成功，初学者入门好帮手，读者打开即可使用-VHDL-based music concert circuit, complete Quartusii programming, tested a total success, a good helper for beginners entry, readers can use to open <周殿凤> 在 2025-02-27 上传
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说明：一个变频程序，按键按下后能够逐步变化频率，直至稳定-A frequency conversion process, after the button press can gradually change frequency, until stable <周殿凤> 在 2025-02-27 上传
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说明：一个verilog实现的16位堆栈型处理器，实现了32条指令，fpga实现频率为26Mhz！-Verilog implementation of a 16-bit stack-based processor to realize the 32 instructions, fpga implementation frequency of 26Mhz! <JOY> 在 2025-02-27 上传
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说明：一个定时器/计数器，里面实现了两个定时计数器，每个都可以写入方式控制器，以实现定时或者计时功能！-A timer/counter, which implements two timer counters, each of which can be written mode controller to achieve the function of time or the time! <JOY> 在 2025-02-27 上传
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