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[其他嵌入式/单片机内容] The-new-chip-key-scanner
说明:单片机新型的按键扫描程序,非常好用,值得下载。-The new chip key scanner<> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] include
说明:单片机89S52和DB18B20实现温度检测和显示-MCU 89S52 and DB18B20 achieve temperature detection and display<一元> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[VHDL编程] vga_display2
说明:VGA xian shi ip core ,qing cankao,duoxie-VGA xian shi ip core, qing cankao, duoxie<lizixi> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[其他嵌入式/单片机内容] C8051F040-FLASH
说明:C8051F040的flash操作例程,调试可用-C8051F040 the flash operation routines, debugging available<刘杨> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] 51Developer
说明:1602和24C02芯片一起编写时钟发生器程序,1602主要用于显示,2402用于随时储存数据, 使得断电后数据能够保存 上电后能继续走动-1602 and 24C02 chip clock generator with the writing process, mainly for 1602 show that 2402 is used to store data at any time, so the data can be s<骆黎> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] wannianli
说明:1602和24C02芯片一起编写万年历(每个月的天数完全按照真实黄历而来) 发生器程序,1602主要用于显示,2402用于随时储存数据, 使得断电后数据能够保存 上电后能继续走动-1602 and 24C02 chips prepared with the calendar (the number of days each month in full accordance with the real almanac from)<骆黎> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[VHDL编程] AdcToplevel
说明:-- Device: Virtex-5 -- Author: Marc Defossez -- Entity Name: AdcToplevel -- Purpose: FPGA interface to a Texas Instruments ADC -- Tools: ISE, XST -- Limitations: none--- Device: Virtex-5 -- Author: Marc Defos<liu qiang> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] chengxu
说明:智能寻迹避障小车,利用Atmeg16对传感器输入的信号进行编程实现小车队黑带的寻迹和对障碍物的避障操作-Intelligent obstacle avoidance tracing the car, use Atmeg16 of sensor input signal to a small team to achieve Black Belt program tracing and obstacle avoidance of obsta<转身已陌> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] max197
说明:用于max197与51单片机的编程,全是C语言编写-for max197<黄海> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[单片机(51,AVR,MSP430等)] DS1302
说明:12864+18B20+DS1302的带温度的实时时钟-12864+18 B20+ DS1302 real time clock with temperature of<joy> 在 2024-11-13 上传 | 大小:5kb | 下载:0
[VHDL编程] Sim_counter
说明:VHDL 在modelsim上进行前仿真,综合仿真以及时序仿真需要文件(以一个简单计数器为例)-On the front in modelsim VHDL simulation, synthesis and timing simulation requires a simulation file (a simple counter example)<yrpk> 在 2024-11-13 上传 | 大小:5kb | 下载:0