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[VHDL编程fir_pipeline_lms

说明:verilog语言编写LMS(最小均方误差)自适应滤波器。-verilog language LMS (least mean square error) adaptive filter.
<刘俊斌> 在 2025-02-28 上传 | 大小:1kb | 下载:0

[VHDL编程fir_lms

说明:verilog语言编写LMS(最小均方误差)自适应滤波器。-verilog language LMS (least mean square error) adaptive filter.
<刘俊斌> 在 2025-02-28 上传 | 大小:1kb | 下载:0

[其他嵌入式/单片机内容motion-detect

说明:motion detection using mega8 and display through hyper terminal-motion detection using mega8 and display through hyper terminal
<embedded> 在 2025-02-28 上传 | 大小:15kb | 下载:0

[uCOS开发uCOS_II_2.52_Reference

说明:uCOS_II 2.52 源码中文注释,每行都有注释喔,是很好的uCOS_II学习资料,感谢译者的无私奉献.-uCOS_II 2.52 Source Chinese translations, each line has the comment Oh, is a good uCOS_II learning materials, thanks to the translator' s dedication.
<advance> 在 2025-02-28 上传 | 大小:1.75mb | 下载:0

[VHDL编程SPI

说明:对SPI协议的RTL实现,相当典型的一个例子。包括时钟分频,移位逻辑等等。-the verilog for spi
<刘明> 在 2025-02-28 上传 | 大小:584kb | 下载:0

[其他嵌入式/单片机内容renyanzheng

说明:(1) 单片机系统的显示与键盘实验; (2)DS18B20测温实验; (3)用多功能实验装置编制程序进行位移(A/D)测量实验; (4)用多功能实验装置编制程序进行转速(脉冲频率)测量实验; -(1) SCM system display and keyboard test (2) DS18B20 temperature experiment (3) programming for multi-functional
<任征> 在 2025-02-28 上传 | 大小:6kb | 下载:0

[DSP编程inductionmotorcrosscoupling

说明:ac induction motor direct field oriented control coupling
<cassie> 在 2025-02-28 上传 | 大小:7kb | 下载:0

[VHDL编程HDB3-Decoding

说明:hdb3解码程序,输入时01代表+1,10代表-1,程序经仿真通过。-hdb3 decoder, input 01 representative of the representative+1,10-1, the program adopted by the simulation.
<李志强> 在 2025-02-28 上传 | 大小:1kb | 下载:0

[VHDL编程HDB3-Coding

说明:HDB3码编码程序,能将普通码编码为HDB3码,输出中11代表V,10代表B,01代表01,00代表0,程序经仿真通过。-HDB3 coding procedures, able to encode common code HDB3 code, representative of the output of 11 V, 10 on behalf of B, 01 representatives on behalf of 01,00 0,
<李志强> 在 2025-02-28 上传 | 大小:2kb | 下载:0

[VHDL编程Multiplier

说明:VHDL语言设计的乘法器,经过试验箱测试通过,用试验箱的8个拨码开关输入数字,按键按下输出结果。-VHDL language design of multiplier, after chamber test, with the chamber of the 8 DIP switch input numbers, key press output.
<李志强> 在 2025-02-28 上传 | 大小:2kb | 下载:0

[VHDL编程Adder

说明:VHDL语言设计的加法器,在试验箱上使用8个拨码开关设置要加的2个数,按键按下输出相加的结果,在试验箱上测试通过。-Adder VHDL language design, in the chamber using the DIP switch setting 8 to 2 to add the number of keys pressed result of the addition output of the chamber on t
<李志强> 在 2025-02-28 上传 | 大小:2kb | 下载:0

[VHDL编程Marquee

说明:VHDL语言设计的跑马灯程序,使用8段数码管,并能递减计时,计时时间到蜂鸣器响声输出,数据在数码管上滚动显示,在试验箱上测试通过。-Marquee VHDL language design process, with 8 of the digital control, and can decrease time, time time to sound the buzzer output, data on the digital scro
<李志强> 在 2025-02-28 上传 | 大小:2kb | 下载:0
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