文件名称:EDA
介绍说明--下载内容均来自于网络,请自行研究使用
程序是用verilog HDL语言写成的抢答器,已经进过测试,绝对可以运行-Program is written in verilog HDL Responder, has been to test, absolutely you can run
(系统自动生成,下载前可以参看下载内容)
下载文件列表
uk\uk.qpf
..\uk.qsf
..\uk.map.rpt
..\uk.flow.rpt
..\uk.map.eqn
..\uk.fit.eqn
..\uk.pin
..\uk.fit.rpt
..\uk.sof
..\uk.pof
..\uk.asm.rpt
..\uk.tan.summary
..\uk.tan.rpt
..\uk.done
..\uk.cdf
..\uk.qws
..\cmp_state.ini
..\uk.v
..\EDA课程设计报告-五路抢答器.doc
..\sim.cfg
..\uk.sim.rpt
..\uk.vwf
..\新建 Microsoft Word 文档.doc
..\db\uk.map.qmsg
..\..\uk.db_info
..\..\uk.tan.qmsg
..\..\uk.fit.qmsg
..\..\uk.rtlv.hdb
..\..\uk.fsf.qmsg
..\..\uk.sim.qmsg
..\..\uk.uk.sld_design_entry.sci
..\..\uk.csf.qmsg
..\..\uk.sgdiff.cdb
..\..\uk_cmp.qrpt
..\..\uk.sim.hdb
..\..\uk.sgdiff.hdb
..\..\uk.pre_map.hdb
..\..\uk.map.hdb
..\..\uk.cmp.rdb
..\..\uk.map.cdb
..\..\uk.hif
..\..\uk_hier_info
..\..\uk_syn_hier_info
..\..\uk.icc
..\..\uk.project.hdb
..\..\uk.sim.rdb
..\..\add_sub_kgh.tdf
..\..\uk.asm.qmsg
..\..\add_sub_hgh.tdf
..\..\uk.rtlv_sg_swap.cdb
..\..\uk.fnsim.hdb
..\..\uk.rtlv_sg.cdb
..\..\uk.frm.hdb
..\..\uk.rpp.qmsg
..\..\uk.cmp.tdb
..\..\uk.cmp.ddb
..\..\uk.cmp.cdb
..\..\uk.cmp.hdb
..\..\uk.rtlv_rvd.rvd
..\..\uk.fnsim.cdb
..\..\uk_sim.qrpt
..\db
uk
..\uk.qsf
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..\uk.done
..\uk.cdf
..\uk.qws
..\cmp_state.ini
..\uk.v
..\EDA课程设计报告-五路抢答器.doc
..\sim.cfg
..\uk.sim.rpt
..\uk.vwf
..\新建 Microsoft Word 文档.doc
..\db\uk.map.qmsg
..\..\uk.db_info
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uk